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H A D | octeon3_lmc.c | 5207 #define VREF_RANGE2_LIMIT 0x18 // range2 is valid for 0x00 - 0x17 macro 5210 #define VREF_LIMIT (VREF_RANGE1_LIMIT + VREF_RANGE2_LIMIT) 5244 if (vref_val < VREF_RANGE2_LIMIT) { in ddr4_vref_loop() 5249 vvalue = vref_val - VREF_RANGE2_LIMIT; in ddr4_vref_loop() 5273 if (final_vref_val < VREF_RANGE2_LIMIT) { in ddr4_vref_loop() 5277 final_vref_val -= VREF_RANGE2_LIMIT; in ddr4_vref_loop() 5286 if (vvlo < VREF_RANGE2_LIMIT) { in ddr4_vref_loop() 5290 vvlo -= VREF_RANGE2_LIMIT; in ddr4_vref_loop() 5293 if (vvhi < VREF_RANGE2_LIMIT) { in ddr4_vref_loop() 5297 vvhi -= VREF_RANGE2_LIMIT; in ddr4_vref_loop()
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/dports/sysutils/u-boot-pine-h64/u-boot-2021.07/drivers/ram/octeon/ |
H A D | octeon3_lmc.c | 5207 #define VREF_RANGE2_LIMIT 0x18 // range2 is valid for 0x00 - 0x17 5210 #define VREF_LIMIT (VREF_RANGE1_LIMIT + VREF_RANGE2_LIMIT) 5244 if (vref_val < VREF_RANGE2_LIMIT) { 5249 vvalue = vref_val - VREF_RANGE2_LIMIT; 5273 if (final_vref_val < VREF_RANGE2_LIMIT) { 5277 final_vref_val -= VREF_RANGE2_LIMIT; 5286 if (vvlo < VREF_RANGE2_LIMIT) { 5290 vvlo -= VREF_RANGE2_LIMIT; 5293 if (vvhi < VREF_RANGE2_LIMIT) { 5297 vvhi -= VREF_RANGE2_LIMIT;
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