1 /* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
2 /*
3  * Copyright (c) 2021, The Linux Foundation. All rights reserved.
4  * Copyright (c) 2022, Linaro Ltd.
5  */
6 
7 #ifndef _DT_BINDINGS_CLK_QCOM_GCC_DIREWOLF_H
8 #define _DT_BINDINGS_CLK_QCOM_GCC_DIREWOLF_H
9 
10 /* GCC clocks */
11 #define GCC_GPLL0					0
12 #define GCC_GPLL0_OUT_EVEN				1
13 #define GCC_GPLL2					2
14 #define GCC_GPLL4					3
15 #define GCC_GPLL7					4
16 #define GCC_GPLL8					5
17 #define GCC_GPLL9					6
18 #define GCC_AGGRE_NOC_PCIE0_TUNNEL_AXI_CLK		7
19 #define GCC_AGGRE_NOC_PCIE1_TUNNEL_AXI_CLK		8
20 #define GCC_AGGRE_NOC_PCIE_4_AXI_CLK			9
21 #define GCC_AGGRE_NOC_PCIE_SOUTH_SF_AXI_CLK		10
22 #define GCC_AGGRE_UFS_CARD_AXI_CLK			11
23 #define GCC_AGGRE_UFS_PHY_AXI_CLK			12
24 #define GCC_AGGRE_USB3_MP_AXI_CLK			13
25 #define GCC_AGGRE_USB3_PRIM_AXI_CLK			14
26 #define GCC_AGGRE_USB3_SEC_AXI_CLK			15
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28 #define GCC_AGGRE_USB4_AXI_CLK				17
29 #define GCC_AGGRE_USB_NOC_AXI_CLK			18
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31 #define GCC_AGGRE_USB_NOC_SOUTH_AXI_CLK			20
32 #define GCC_AHB2PHY0_CLK				21
33 #define GCC_AHB2PHY2_CLK				22
34 #define GCC_BOOT_ROM_AHB_CLK				23
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40 #define GCC_CAMERA_THROTTLE_XO_CLK			29
41 #define GCC_CAMERA_XO_CLK				30
42 #define GCC_CFG_NOC_USB3_MP_AXI_CLK			31
43 #define GCC_CFG_NOC_USB3_PRIM_AXI_CLK			32
44 #define GCC_CFG_NOC_USB3_SEC_AXI_CLK			33
45 #define GCC_CNOC_PCIE0_TUNNEL_CLK			34
46 #define GCC_CNOC_PCIE1_TUNNEL_CLK			35
47 #define GCC_CNOC_PCIE4_QX_CLK				36
48 #define GCC_DDRSS_GPU_AXI_CLK				37
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50 #define GCC_DISP1_AHB_CLK				39
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61 #define GCC_DISP_XO_CLK					50
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90 #define GCC_GPU_TCU_THROTTLE_AHB_CLK			79
91 #define GCC_GPU_TCU_THROTTLE_CLK			80
92 #define GCC_PCIE0_PHY_RCHNG_CLK				81
93 #define GCC_PCIE1_PHY_RCHNG_CLK				82
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100 #define GCC_PCIE_0_AUX_CLK_SRC				89
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112 #define GCC_PCIE_1_PIPE_CLK				101
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186 #define GCC_QMIP_DISP_ROT_AHB_CLK			175
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261 #define GCC_SYS_NOC_USB_AXI_CLK				250
262 #define GCC_UFS_1_CARD_CLKREF_CLK			251
263 #define GCC_UFS_CARD_AHB_CLK				252
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266 #define GCC_UFS_CARD_CLKREF_CLK				255
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270 #define GCC_UFS_CARD_PHY_AUX_CLK_SRC			259
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278 #define GCC_UFS_CARD_UNIPRO_CORE_CLK_SRC		267
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280 #define GCC_UFS_PHY_AXI_CLK				269
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290 #define GCC_UFS_PHY_TX_SYMBOL_0_CLK			279
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292 #define GCC_UFS_PHY_UNIPRO_CORE_CLK			281
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294 #define GCC_UFS_REF_CLKREF_CLK				283
295 #define GCC_USB2_HS0_CLKREF_CLK				284
296 #define GCC_USB2_HS1_CLKREF_CLK				285
297 #define GCC_USB2_HS2_CLKREF_CLK				286
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299 #define GCC_USB30_MP_MASTER_CLK				288
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301 #define GCC_USB30_MP_MOCK_UTMI_CLK			290
302 #define GCC_USB30_MP_MOCK_UTMI_CLK_SRC			291
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304 #define GCC_USB30_MP_SLEEP_CLK				293
305 #define GCC_USB30_PRIM_MASTER_CLK			294
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309 #define GCC_USB30_PRIM_MOCK_UTMI_POSTDIV_CLK_SRC	298
310 #define GCC_USB30_PRIM_SLEEP_CLK			299
311 #define GCC_USB30_SEC_MASTER_CLK			300
312 #define GCC_USB30_SEC_MASTER_CLK_SRC			301
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316 #define GCC_USB30_SEC_SLEEP_CLK				305
317 #define GCC_USB34_PRIM_PHY_PIPE_CLK_SRC			306
318 #define GCC_USB34_SEC_PHY_PIPE_CLK_SRC			307
319 #define GCC_USB3_MP0_CLKREF_CLK				308
320 #define GCC_USB3_MP1_CLKREF_CLK				309
321 #define GCC_USB3_MP_PHY_AUX_CLK				310
322 #define GCC_USB3_MP_PHY_AUX_CLK_SRC			311
323 #define GCC_USB3_MP_PHY_COM_AUX_CLK			312
324 #define GCC_USB3_MP_PHY_PIPE_0_CLK			313
325 #define GCC_USB3_MP_PHY_PIPE_0_CLK_SRC			314
326 #define GCC_USB3_MP_PHY_PIPE_1_CLK			315
327 #define GCC_USB3_MP_PHY_PIPE_1_CLK_SRC			316
328 #define GCC_USB3_PRIM_PHY_AUX_CLK			317
329 #define GCC_USB3_PRIM_PHY_AUX_CLK_SRC			318
330 #define GCC_USB3_PRIM_PHY_COM_AUX_CLK			319
331 #define GCC_USB3_PRIM_PHY_PIPE_CLK			320
332 #define GCC_USB3_PRIM_PHY_PIPE_CLK_SRC			321
333 #define GCC_USB3_SEC_PHY_AUX_CLK			322
334 #define GCC_USB3_SEC_PHY_AUX_CLK_SRC			323
335 #define GCC_USB3_SEC_PHY_COM_AUX_CLK			324
336 #define GCC_USB3_SEC_PHY_PIPE_CLK			325
337 #define GCC_USB3_SEC_PHY_PIPE_CLK_SRC			326
338 #define GCC_USB4_1_CFG_AHB_CLK				327
339 #define GCC_USB4_1_DP_CLK				328
340 #define GCC_USB4_1_MASTER_CLK				329
341 #define GCC_USB4_1_MASTER_CLK_SRC			330
342 #define GCC_USB4_1_PHY_DP_CLK_SRC			331
343 #define GCC_USB4_1_PHY_P2RR2P_PIPE_CLK			332
344 #define GCC_USB4_1_PHY_P2RR2P_PIPE_CLK_SRC		333
345 #define GCC_USB4_1_PHY_PCIE_PIPE_CLK			334
346 #define GCC_USB4_1_PHY_PCIE_PIPE_CLK_SRC		335
347 #define GCC_USB4_1_PHY_PCIE_PIPE_MUX_CLK_SRC		336
348 #define GCC_USB4_1_PHY_PCIE_PIPEGMUX_CLK_SRC		337
349 #define GCC_USB4_1_PHY_RX0_CLK				338
350 #define GCC_USB4_1_PHY_RX0_CLK_SRC			339
351 #define GCC_USB4_1_PHY_RX1_CLK				340
352 #define GCC_USB4_1_PHY_RX1_CLK_SRC			341
353 #define GCC_USB4_1_PHY_SYS_CLK_SRC			342
354 #define GCC_USB4_1_PHY_USB_PIPE_CLK			343
355 #define GCC_USB4_1_SB_IF_CLK				344
356 #define GCC_USB4_1_SB_IF_CLK_SRC			345
357 #define GCC_USB4_1_SYS_CLK				346
358 #define GCC_USB4_1_TMU_CLK				347
359 #define GCC_USB4_1_TMU_CLK_SRC				348
360 #define GCC_USB4_CFG_AHB_CLK				349
361 #define GCC_USB4_CLKREF_CLK				350
362 #define GCC_USB4_DP_CLK					351
363 #define GCC_USB4_EUD_CLKREF_CLK				352
364 #define GCC_USB4_MASTER_CLK				353
365 #define GCC_USB4_MASTER_CLK_SRC				354
366 #define GCC_USB4_PHY_DP_CLK_SRC				355
367 #define GCC_USB4_PHY_P2RR2P_PIPE_CLK			356
368 #define GCC_USB4_PHY_P2RR2P_PIPE_CLK_SRC		357
369 #define GCC_USB4_PHY_PCIE_PIPE_CLK			358
370 #define GCC_USB4_PHY_PCIE_PIPE_CLK_SRC			359
371 #define GCC_USB4_PHY_PCIE_PIPE_MUX_CLK_SRC		360
372 #define GCC_USB4_PHY_PCIE_PIPEGMUX_CLK_SRC		361
373 #define GCC_USB4_PHY_RX0_CLK				362
374 #define GCC_USB4_PHY_RX0_CLK_SRC			363
375 #define GCC_USB4_PHY_RX1_CLK				364
376 #define GCC_USB4_PHY_RX1_CLK_SRC			365
377 #define GCC_USB4_PHY_SYS_CLK_SRC			366
378 #define GCC_USB4_PHY_USB_PIPE_CLK			367
379 #define GCC_USB4_SB_IF_CLK				368
380 #define GCC_USB4_SB_IF_CLK_SRC				369
381 #define GCC_USB4_SYS_CLK				370
382 #define GCC_USB4_TMU_CLK				371
383 #define GCC_USB4_TMU_CLK_SRC				372
384 #define GCC_VIDEO_AHB_CLK				373
385 #define GCC_VIDEO_AXI0_CLK				374
386 #define GCC_VIDEO_AXI1_CLK				375
387 #define GCC_VIDEO_CVP_THROTTLE_CLK			376
388 #define GCC_VIDEO_VCODEC_THROTTLE_CLK			377
389 #define GCC_VIDEO_XO_CLK				378
390 #define GCC_AGGRE_UFS_CARD_AXI_HW_CTL_CLK		379
391 #define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK		380
392 #define GCC_UFS_CARD_AXI_HW_CTL_CLK			381
393 #define GCC_UFS_CARD_ICE_CORE_HW_CTL_CLK		382
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395 #define GCC_UFS_CARD_UNIPRO_CORE_HW_CTL_CLK		384
396 #define GCC_UFS_PHY_AXI_HW_CTL_CLK			385
397 #define GCC_UFS_PHY_ICE_CORE_HW_CTL_CLK			386
398 #define GCC_UFS_PHY_PHY_AUX_HW_CTL_CLK			387
399 #define GCC_UFS_PHY_UNIPRO_CORE_HW_CTL_CLK		388
400 
401 /* GCC resets */
402 #define GCC_EMAC0_BCR					0
403 #define GCC_EMAC1_BCR					1
404 #define GCC_PCIE_0_LINK_DOWN_BCR			2
405 #define GCC_PCIE_0_NOCSR_COM_PHY_BCR			3
406 #define GCC_PCIE_0_PHY_BCR				4
407 #define GCC_PCIE_0_PHY_NOCSR_COM_PHY_BCR		5
408 #define GCC_PCIE_0_TUNNEL_BCR				6
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410 #define GCC_PCIE_1_NOCSR_COM_PHY_BCR			8
411 #define GCC_PCIE_1_PHY_BCR				9
412 #define GCC_PCIE_1_PHY_NOCSR_COM_PHY_BCR		10
413 #define GCC_PCIE_1_TUNNEL_BCR				11
414 #define GCC_PCIE_2A_BCR					12
415 #define GCC_PCIE_2A_LINK_DOWN_BCR			13
416 #define GCC_PCIE_2A_NOCSR_COM_PHY_BCR			14
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419 #define GCC_PCIE_2B_BCR					17
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422 #define GCC_PCIE_2B_PHY_BCR				20
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424 #define GCC_PCIE_3A_BCR					22
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429 #define GCC_PCIE_3B_BCR					27
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432 #define GCC_PCIE_3B_PHY_BCR				30
433 #define GCC_PCIE_3B_PHY_NOCSR_COM_PHY_BCR		31
434 #define GCC_PCIE_4_BCR					32
435 #define GCC_PCIE_4_LINK_DOWN_BCR			33
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437 #define GCC_PCIE_4_PHY_BCR				35
438 #define GCC_PCIE_4_PHY_NOCSR_COM_PHY_BCR		36
439 #define GCC_PCIE_PHY_CFG_AHB_BCR			37
440 #define GCC_PCIE_PHY_COM_BCR				38
441 #define GCC_PCIE_RSCC_BCR				39
442 #define GCC_QUSB2PHY_HS0_MP_BCR				40
443 #define GCC_QUSB2PHY_HS1_MP_BCR				41
444 #define GCC_QUSB2PHY_HS2_MP_BCR				42
445 #define GCC_QUSB2PHY_HS3_MP_BCR				43
446 #define GCC_QUSB2PHY_PRIM_BCR				44
447 #define GCC_QUSB2PHY_SEC_BCR				45
448 #define GCC_SDCC2_BCR					46
449 #define GCC_SDCC4_BCR					47
450 #define GCC_UFS_CARD_BCR				48
451 #define GCC_UFS_PHY_BCR					49
452 #define GCC_USB2_PHY_PRIM_BCR				50
453 #define GCC_USB2_PHY_SEC_BCR				51
454 #define GCC_USB30_MP_BCR				52
455 #define GCC_USB30_PRIM_BCR				53
456 #define GCC_USB30_SEC_BCR				54
457 #define GCC_USB3_DP_PHY_PRIM_BCR			55
458 #define GCC_USB3_DP_PHY_SEC_BCR				56
459 #define GCC_USB3_PHY_PRIM_BCR				57
460 #define GCC_USB3_PHY_SEC_BCR				58
461 #define GCC_USB3_UNIPHY_MP0_BCR				59
462 #define GCC_USB3_UNIPHY_MP1_BCR				60
463 #define GCC_USB3PHY_PHY_PRIM_BCR			61
464 #define GCC_USB3PHY_PHY_SEC_BCR				62
465 #define GCC_USB3UNIPHY_PHY_MP0_BCR			63
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467 #define GCC_USB4_1_BCR					65
468 #define GCC_USB4_1_DP_PHY_PRIM_BCR			66
469 #define GCC_USB4_1_DPPHY_AUX_BCR			67
470 #define GCC_USB4_1_PHY_PRIM_BCR				68
471 #define GCC_USB4_BCR					69
472 #define GCC_USB4_DP_PHY_PRIM_BCR			70
473 #define GCC_USB4_DPPHY_AUX_BCR				71
474 #define GCC_USB4_PHY_PRIM_BCR				72
475 #define GCC_USB4PHY_1_PHY_PRIM_BCR			73
476 #define GCC_USB4PHY_PHY_PRIM_BCR			74
477 #define GCC_USB_PHY_CFG_AHB2PHY_BCR			75
478 #define GCC_VIDEO_BCR					76
479 #define GCC_VIDEO_AXI0_CLK_ARES				77
480 #define GCC_VIDEO_AXI1_CLK_ARES				78
481 
482 /* GCC GDSCs */
483 #define PCIE_0_TUNNEL_GDSC				0
484 #define PCIE_1_TUNNEL_GDSC				1
485 #define PCIE_2A_GDSC					2
486 #define PCIE_2B_GDSC					3
487 #define PCIE_3A_GDSC					4
488 #define PCIE_3B_GDSC					5
489 #define PCIE_4_GDSC					6
490 #define UFS_CARD_GDSC					7
491 #define UFS_PHY_GDSC					8
492 #define USB30_MP_GDSC					9
493 #define USB30_PRIM_GDSC					10
494 #define USB30_SEC_GDSC					11
495 #define EMAC_0_GDSC					12
496 #define EMAC_1_GDSC					13
497 
498 #endif
499