xref: /linux/include/dt-bindings/clock/qcom,sa8775p-gcc.h (revision 0fff9fa0)

/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
/*
 * Copyright (c) 2022, Qualcomm Innovation Center, Inc. All rights reserved.
 * Copyright (c) 2023, Linaro Limited
 */

#ifndef _DT_BINDINGS_CLK_QCOM_GCC_SA8775P_H
#define _DT_BINDINGS_CLK_QCOM_GCC_SA8775P_H

/* GCC clocks */
#define GCC_GPLL0					0
#define GCC_GPLL0_OUT_EVEN				1
#define GCC_GPLL1					2
#define GCC_GPLL4					3
#define GCC_GPLL5					4
#define GCC_GPLL7					5
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#define GCC_USB_CLKREF_EN				239
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#define GCC_VIDEO_XO_CLK				243
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#define GCC_UFS_PHY_UNIPRO_CORE_HW_CTL_CLK		248

/* GCC resets */
#define GCC_CAMERA_BCR					0
#define GCC_DISPLAY1_BCR				1
#define GCC_DISPLAY_BCR					2
#define GCC_EMAC0_BCR					3
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#define GCC_MMSS_BCR					6
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#define GCC_PCIE_0_NOCSR_COM_PHY_BCR			9
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#define GCC_PCIE_1_BCR					12
#define GCC_PCIE_1_LINK_DOWN_BCR			13
#define GCC_PCIE_1_NOCSR_COM_PHY_BCR			14
#define GCC_PCIE_1_PHY_BCR				15
#define GCC_PCIE_1_PHY_NOCSR_COM_PHY_BCR		16
#define GCC_PDM_BCR					17
#define GCC_QUPV3_WRAPPER_0_BCR				18
#define GCC_QUPV3_WRAPPER_1_BCR				19
#define GCC_QUPV3_WRAPPER_2_BCR				20
#define GCC_QUPV3_WRAPPER_3_BCR				21
#define GCC_SDCC1_BCR					22
#define GCC_TSCSS_BCR					23
#define GCC_UFS_CARD_BCR				24
#define GCC_UFS_PHY_BCR					25
#define GCC_USB20_PRIM_BCR				26
#define GCC_USB2_PHY_PRIM_BCR				27
#define GCC_USB2_PHY_SEC_BCR				28
#define GCC_USB30_PRIM_BCR				29
#define GCC_USB30_SEC_BCR				30
#define GCC_USB3_DP_PHY_PRIM_BCR			31
#define GCC_USB3_DP_PHY_SEC_BCR				32
#define GCC_USB3_PHY_PRIM_BCR				33
#define GCC_USB3_PHY_SEC_BCR				34
#define GCC_USB3_PHY_TERT_BCR				35
#define GCC_USB3_UNIPHY_MP0_BCR				36
#define GCC_USB3_UNIPHY_MP1_BCR				37
#define GCC_USB3PHY_PHY_PRIM_BCR			38
#define GCC_USB3PHY_PHY_SEC_BCR				39
#define GCC_USB3UNIPHY_PHY_MP0_BCR			40
#define GCC_USB3UNIPHY_PHY_MP1_BCR			41
#define GCC_USB_PHY_CFG_AHB2PHY_BCR			42
#define GCC_VIDEO_BCR					43
#define GCC_VIDEO_AXI0_CLK_ARES				44
#define GCC_VIDEO_AXI1_CLK_ARES				45

/* GCC GDSCs */
#define PCIE_0_GDSC					0
#define PCIE_1_GDSC					1
#define UFS_CARD_GDSC					2
#define UFS_PHY_GDSC					3
#define USB20_PRIM_GDSC					4
#define USB30_PRIM_GDSC					5
#define USB30_SEC_GDSC					6
#define EMAC0_GDSC					7
#define EMAC1_GDSC					8

#endif /* _DT_BINDINGS_CLK_QCOM_GCC_SA8775P_H */