/dports/multimedia/v4l-utils/linux-5.13-rc2/arch/mips/pci/ |
H A D | pcie-octeon.c | 1152 union cvmx_pemx_bar_ctl pemx_bar_ctl; in __cvmx_pcie_rc_initialize_gen2() local 1392 pemx_bar_ctl.u64 = cvmx_read_csr(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_rc_initialize_gen2() 1393 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1*/ in __cvmx_pcie_rc_initialize_gen2() 1394 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_rc_initialize_gen2() 1395 pemx_bar_ctl.s.bar2_esx = 1; in __cvmx_pcie_rc_initialize_gen2() 1396 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_rc_initialize_gen2() 1397 cvmx_write_csr(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_rc_initialize_gen2()
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/dports/multimedia/v4l_compat/linux-5.13-rc2/arch/mips/pci/ |
H A D | pcie-octeon.c | 1152 union cvmx_pemx_bar_ctl pemx_bar_ctl; in __cvmx_pcie_rc_initialize_gen2() local 1392 pemx_bar_ctl.u64 = cvmx_read_csr(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_rc_initialize_gen2() 1393 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1*/ in __cvmx_pcie_rc_initialize_gen2() 1394 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_rc_initialize_gen2() 1395 pemx_bar_ctl.s.bar2_esx = 1; in __cvmx_pcie_rc_initialize_gen2() 1396 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_rc_initialize_gen2() 1397 cvmx_write_csr(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_rc_initialize_gen2()
|
/dports/multimedia/libv4l/linux-5.13-rc2/arch/mips/pci/ |
H A D | pcie-octeon.c | 1152 union cvmx_pemx_bar_ctl pemx_bar_ctl; in __cvmx_pcie_rc_initialize_gen2() local 1392 pemx_bar_ctl.u64 = cvmx_read_csr(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_rc_initialize_gen2() 1393 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1*/ in __cvmx_pcie_rc_initialize_gen2() 1394 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_rc_initialize_gen2() 1395 pemx_bar_ctl.s.bar2_esx = 1; in __cvmx_pcie_rc_initialize_gen2() 1396 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_rc_initialize_gen2() 1397 cvmx_write_csr(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_rc_initialize_gen2()
|
/dports/sysutils/u-boot-olinuxino-lime/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
|
/dports/sysutils/u-boot-olinuxino-lime2-emmc/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
|
/dports/sysutils/u-boot-olinuxino-lime2/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
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/dports/sysutils/u-boot-chip/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
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/dports/sysutils/u-boot-cubox-hummingboard/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
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/dports/sysutils/u-boot-firefly-rk3399/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
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/dports/sysutils/u-boot-sopine/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
|
/dports/sysutils/u-boot-a64-olinuxino/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
|
/dports/sysutils/u-boot-sopine-spi/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
|
/dports/sysutils/u-boot-rpi-0-w/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
|
/dports/sysutils/u-boot-qemu-arm64/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
|
/dports/sysutils/u-boot-olimex-a20-som-evb/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
|
/dports/sysutils/u-boot-nanopi-r4s/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
|
/dports/sysutils/u-boot-nanopi-m1plus/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
|
/dports/sysutils/u-boot-nanopi-neo/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
|
/dports/sysutils/u-boot-wandboard/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
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/dports/sysutils/u-boot-cubieboard/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
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/dports/sysutils/u-boot-clearfog/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
|
/dports/sysutils/u-boot-cubieboard2/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
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/dports/sysutils/u-boot-pandaboard/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
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/dports/sysutils/u-boot-orangepi-zero/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
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/dports/sysutils/u-boot-orangepi-zero-plus/u-boot-2021.07/arch/mips/mach-octeon/ |
H A D | cvmx-pcie.c | 1073 cvmx_pemx_bar_ctl_t pemx_bar_ctl; in __cvmx_pcie_sli_config() local 1137 pemx_bar_ctl.u64 = CVMX_READ_CSR(CVMX_PEMX_BAR_CTL(pcie_port)); in __cvmx_pcie_sli_config() 1138 pemx_bar_ctl.s.bar1_siz = 3; /* 256MB BAR1 */ in __cvmx_pcie_sli_config() 1139 pemx_bar_ctl.s.bar2_enb = 1; in __cvmx_pcie_sli_config() 1140 pemx_bar_ctl.s.bar2_esx = _CVMX_PCIE_ES; in __cvmx_pcie_sli_config() 1141 pemx_bar_ctl.s.bar2_cax = 0; in __cvmx_pcie_sli_config() 1142 CVMX_WRITE_CSR(CVMX_PEMX_BAR_CTL(pcie_port), pemx_bar_ctl.u64); in __cvmx_pcie_sli_config()
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