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H A D | master_control_multi.v | 31 output tx_bus_reset, output rx_bus_reset, port 48 .tx_bus_reset(tx_bus_reset),.rx_bus_reset(rx_bus_reset),
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H A D | master_control.v | 28 output tx_bus_reset, output rx_bus_reset, port 79 assign tx_bus_reset = tx_reset_bus_sync2;
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/dports/comms/uhd/uhd-90ce6062b6b5df2eddeee723777be85108e4e7c7/fpga/usrp1/toplevel/usrp_multi/ |
H A D | usrp_multi.v | 108 wire tx_dsp_reset, rx_dsp_reset, tx_bus_reset, rx_bus_reset; net 145 ( .usbclk(usbclk),.bus_reset(tx_bus_reset),.reset(tx_dsp_reset), 337 .tx_bus_reset(tx_bus_reset),.rx_bus_reset(rx_bus_reset), 347 …strobe,serial_addr}),.debug_3({rx_dsp_reset,tx_dsp_reset,rx_bus_reset,tx_bus_reset,enable_rx,tx_un… 355 .tx_bus_reset(tx_bus_reset),.rx_bus_reset(rx_bus_reset), 364 …strobe,serial_addr}),.debug_3({rx_dsp_reset,tx_dsp_reset,rx_bus_reset,tx_bus_reset,enable_rx,tx_un…
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/dports/comms/uhd/uhd-90ce6062b6b5df2eddeee723777be85108e4e7c7/fpga/usrp1/toplevel/usrp_inband_usb/ |
H A D | usrp_inband_usb.v | 94 wire tx_dsp_reset, rx_dsp_reset, tx_bus_reset, rx_bus_reset; net 135 ( .usbclk(usbclk),.bus_reset(tx_bus_reset),.reset(tx_dsp_reset), 164 ( .usbclk(usbclk),.bus_reset(tx_bus_reset),.reset(tx_dsp_reset), 406 .tx_bus_reset(tx_bus_reset),.rx_bus_reset(rx_bus_reset), 415 …strobe,serial_addr}),.debug_3({rx_dsp_reset,tx_dsp_reset,rx_bus_reset,tx_bus_reset,enable_rx,tx_un…
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/dports/comms/uhd/uhd-90ce6062b6b5df2eddeee723777be85108e4e7c7/fpga/usrp1/toplevel/mrfm/ |
H A D | mrfm.v | 93 wire tx_dsp_reset, rx_dsp_reset, tx_bus_reset, rx_bus_reset; net 179 .tx_bus_reset(tx_bus_reset),.rx_bus_reset(rx_bus_reset),
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/dports/comms/uhd/uhd-90ce6062b6b5df2eddeee723777be85108e4e7c7/fpga/usrp1/toplevel/usrp_std/ |
H A D | usrp_std.v | 99 wire tx_dsp_reset, rx_dsp_reset, tx_bus_reset, rx_bus_reset; net 133 ( .usbclk(usbclk), .bus_reset(tx_bus_reset), 311 .tx_bus_reset(tx_bus_reset),.rx_bus_reset(rx_bus_reset),
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